ST7232A(K2)TA/XXXRE datasheet, PDF - EEWORLD Datasheet

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Datasheet> All Categories > The embedded processor and controller> Microcontrollers and processors> ST7232A(K2)TA/XXXRE

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ST7232A(K2)TA/XXXRE: Description8-BIT, MROM, 8MHz, MICROCONTROLLER, PQFP32, 7 X 7 MM, ROHS COMPLIANT, LQFP-32; CategoryThe embedded processor and controller Microcontrollers and processors; File Size4MB，201 Pages; ManufacturerSTMicroelectronics; Websitehttp://www.st.com/

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ST7232A(K2)TA/XXXRE Overview

8-BIT, MROM, 8MHz, MICROCONTROLLER, PQFP32, 7 X 7 MM, ROHS COMPLIANT, LQFP-32

ST7232A(K2)TA/XXXRE Parametric

Parameter Name	Attribute value
Maker	STMicroelectronics
Parts packaging code	QFP
package instruction	LQFP,
Contacts	32
Reach Compliance Code	unknown
Has ADC	YES
Other features	ALSO OPERATES AT 3.8 V MINIMUM SUPPLY
Address bus width
bit size	8
maximum clock frequency	16 MHz
DAC channel	NO
DMA channel	NO
External data bus width
JESD-30 code	S-PQFP-G32
JESD-609 code	e4
length	7 mm
Number of I/O lines	24
Number of terminals	32
Maximum operating temperature	85 °C
Minimum operating temperature	-40 °C
PWM channel	YES
Package body material	PLASTIC/EPOXY
encapsulated code	LQFP
Package shape	SQUARE
Package form	FLATPACK, LOW PROFILE
Certification status	Not Qualified
ROM programmability	MROM
Maximum seat height	1.6 mm
speed	8 MHz
Maximum supply voltage	5.5 V
Minimum supply voltage	3.8 V
Nominal supply voltage	5 V
surface mount	YES
technology	CMOS
Temperature level	INDUSTRIAL
Terminal surface	NICKEL PALLADIUM GOLD
Terminal form	GULL WING
Terminal pitch	0.8 mm
Terminal location	QUAD
width	7 mm
uPs/uCs/peripheral integrated circuit type	MICROCONTROLLER

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ST7232AK1-Auto ST7232AK2-Auto

ST7232AJ1-Auto ST7232AJ2-Auto

8-bit MCU for automotive, 16 Kbyte Flash/ROM,

10-bit ADC, 4 timers, SPI, SCI

Features

■

Memories

– 8K dual voltage high density Flash

(HDFlash) or ROM with read-out protection

capability. In-application programming and

in-circuit programming for HDFlash devices

– 384 bytes RAM

– HDFlash endurance: 100 cycles, data

retention: 20 years at 55°C

Clock, reset and supply management

– Clock sources: crystal/ceramic resonator

oscillators and bypass for external clock

– PLL for 2x frequency multiplication

– Four power saving modes: halt, active halt,

wait and slow

Interrupt management

– Nested interrupt controller

– 14 interrupt vectors plus TRAP and reset

– 6 external interrupt lines (on 4 vectors)

■

LQFP32 7 x 7

LQFP44 10 x 10

■

– Main clock controller with: real time base,

beep and clock-out capabilities

– Configurable watchdog timer

– Two 16-bit timers with: 2 input captures, 2

output compares, PWM and pulse

generator modes

2 communications interfaces

– SPI synchronous serial interface

– SCI asynchronous serial interface

■

■

■

1 analog peripheral (low current coupling)

– 10-bit ADC with up to 12 robust input ports

Instruction set

– 8-bit data manipulation

– 63 basic instructions

– 17 main addressing modes

– 8 x 8 unsigned multiply instruction

Development tools

– Full hardware/software development

package

– In-circuit testing capability

■

Up to 32 I/O ports

– 32/24 multifunctional bidirectional I/O lines

– 22/17 alternate function lines

– 12/10 high sink outputs

4 timers

■

Table 1.

ST72F32AK1-Auto

b

O

ST72F32AK2-Auto

ST72F32AJ1-Auto

ST72F32AJ2-Auto

ST7232AK1-Auto

ST7232AK2-Auto

ST7232AJ1-Auto

ST7232AJ2-Auto

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Device summary

Program memory - bytes RAM (stack) - bytes Operating volt. Temp. range Package

Flash 4K

LQFP32

Flash 8K

Flash 4K

LQFP44

Flash 8K

384 (256)

ROM 4K

ROM 8K

ROM 4K

LQFP44

ROM 8K

3.8V to 5.5V

-40°C to

+125°C

LQFP32

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January 2008

Rev 1

1/201

www.st.com

1

Contents

ST7232Axx-Auto

Contents

1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

1.1

1.2

Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

Differences between ST7232A-Auto and ST7232A datasheets . . . . . . . . 15

1.2.1

1.2.2

1.2.3

Principal differences . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Minor content differences . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

Editing and formatting differences . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

2

3

4

Pin description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Register and memory map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

Flash program memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

4.1

4.2

4.3

4.4

4.5

4.6

4.7

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Structure . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

4.3.1

Read-out protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

ICC interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

In-Circuit Programming (ICP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

In-application programming (IAP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Related documentation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

5

Central processing unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

5.1

5.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

CPU registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

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6

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5.3

6.1

6.2

6.3

6.4

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Supply, reset and clock management . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Phase locked loop (PLL) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Multi-oscillator (MO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

6.4.1

6.4.2

External clock source . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

Crystal/ceramic oscillators . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

2/201

ST7232Axx-Auto

Contents

6.5

Reset sequence manager (RSM) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

6.5.1

6.5.2

6.5.3

6.5.4

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

Asynchronous external RESET pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

External power on reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

Internal watchdog reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

6.6

System integrity management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

7

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

7.1

7.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

Masking and processing flow . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42

7.2.1

7.2.2

7.2.3

7.2.4

Servicing pending interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Different interrupt vector sources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

Non-maskable sources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

Maskable sources . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

7.3

7.4

7.5

7.6

7.7

7.8

7.9

7.10

Interrupts and low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

Concurrent and nested management . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

Interrupt registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47

Interrupt related instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

External interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

7.7.1

I/O port interrupt sensitivity . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

External interrupt control register (EICR) . . . . . . . . . . . . . . . . . . . . . . . . . 51

Nested interrupts register map and reset value . . . . . . . . . . . . . . . . . . . . 53

Interrupt mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 53

8

Power saving modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

8.1

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

Slow mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

Wait mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55

Active halt and halt modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 56

8.4.1

8.4.2

Active halt mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57

Halt mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 58

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8.2

8.3

8.4

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I/O ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

9.1

9.2

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

FUNCTIONAL DESCRIPTION . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

3/201

Contents

9.2.1

9.2.2

9.2.3

ST7232Axx-Auto

Input modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

Output modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

Alternate functions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

9.3

9.4

9.5

I/O port implementation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67

10

On-chip peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

10.1

Watchdog timer (WDG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

10.1.1

10.1.2

10.1.3

10.1.4

10.1.5

10.1.6

10.1.7

10.1.8

10.1.9

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

How to program the watchdog timeout . . . . . . . . . . . . . . . . . . . . . . . . . 70

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Hardware watchdog option . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Using halt mode with the WDG (WDGHALT option) . . . . . . . . . . . . . . . 72

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 72

Control register (WDGCR) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

10.1.10 Watchdog timer register map and reset values . . . . . . . . . . . . . . . . . . . 73

10.2

Main clock controller with real-time clock and beeper (MCC/RTC) . . . . . 73

10.2.1

10.2.2

10.2.3

10.2.4

10.2.5

10.2.6

10.2.7

Programmable CPU clock prescaler . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

Clock-out capability . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

Real-time clock timer (RTC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

Beeper . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 75

MCC/RTC registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

MCC register map and reset values . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

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10.3

10.2.8

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16-bit timer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

10.3.1

10.3.2

10.3.3

10.3.4

10.3.5

10.3.6

10.3.7

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

Summary of timer modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

16-bit timer registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

4/201

ST7232Axx-Auto

Contents

10.4

Serial peripheral interface (SPI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

10.4.1

10.4.2

10.4.3

10.4.4

10.4.5

10.4.6

10.4.7

10.4.8

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

General description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 103

Clock phase and clock polarity . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 108

Error flags . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 110

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 112

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113

SPI registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 113

10.5

Serial communications interface (SCI) . . . . . . . . . . . . . . . . . . . . . . . . . . 117

10.5.1

10.5.2

10.5.3

10.5.4

10.5.5

10.5.6

10.5.7

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117

General description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 118

Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 120

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

SCI registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 131

10.6

10-bit A/D converter (ADC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139

10.6.1

10.6.2

10.6.3

10.6.4

10.6.5

10.6.6

Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139

Main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 139

Functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 140

Low power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

10-bit ADC registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 141

11

Instruction set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

11.1

CPU addressing modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 144

11.1.1

11.1.2

11.1.3

11.1.4

11.1.5

11.1.6

11.1.7

Inherent instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

Immediate instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

Direct instructions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 147

Indexed instructions (no offset, short, long) . . . . . . . . . . . . . . . . . . . . . 147

Indirect instructions (short, long) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 147

Indirect indexed instructions (short, long) . . . . . . . . . . . . . . . . . . . . . . 148

Relative mode instructions (direct, indirect) . . . . . . . . . . . . . . . . . . . . . 149

b

O

so

te

le

11.2

11.3

r

P

uc

od

s)

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od

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uc

Instruction groups . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

Using a pre-byte . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150

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